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| 二进制 转换成十进制 BCD码(加3移位法) | 12787 | 4 | 0 | 2010-07-05 | |
| CycloneII特殊管脚的使用 | 1081 | 0 | 0 | 2010-07-02 | |
| CycloneII特殊管脚的使用 | 2617 | 0 | 0 | 2010-07-02 | |
| 高手进阶,终极内存技术指南——完整 | 1093 | 0 | 0 | 2010-07-02 | |
| 技术人才离职原因分析 | 1027 | 0 | 0 | 2010-07-01 | |
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| 嵌入式存储器的设计方法和策略 | 1262 | 0 | 0 | 2010-06-30 | |
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| 基于Verilog的VGA驱动设计(一)VGA时序分析 | 4020 | 0 | 0 | 2010-06-30 | |
| 我的FPGA学习历程 | 1216 | 0 | 1 | 2010-06-27 | |
| 有限状态机的VHDL优化设计(下) | 1978 | 0 | 0 | 2010-06-24 | |
| 有限状态机的VHDL优化设计(上) | 1644 | 0 | 0 | 2010-06-24 | |
| 联想FPGA实习项目后11点感受(转载) | 904 | 0 | 0 | 2010-06-21 | |
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| verilog assign语句的用法未解之谜 | 13326 | 1 | 1 | 2010-06-19 | |
| $strobe $monitor $display | 1807 | 0 | 0 | 2010-06-19 | |
| (Verilog HDL)阻塞赋值和非阻塞赋值的区别和使用 | 15113 | 2 | 0 | 2010-06-08 | |
| (Verilog HDL)wire型和reg型的电路区别 | 9762 | 0 | 0 | 2010-06-08 |